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Verilog HDL相关的非阻塞赋值

来源:学生作业帮 编辑:作业帮 分类:综合作业 时间:2024/08/26 20:39:13
Verilog HDL相关的非阻塞赋值
有个语句:求说明一下当x=a,m=2时,这个程序的信号走向,每个语句是怎么执行的?
case(x)
a:if(m==2)
begin
head;
q
1)x=a,首先是执行case的a分支
2)m=2,执行if的m=2分支, 依次执行 head(m